STA380BW datasheet(6/162 Pages) STMICROELECTRONICS

6 / 162 page

Contents

STA380BW

6/162

DocID024543 Rev 1

6.27

Short-circuit protection mode registers SHOK (address 0x58) . . . . . . . . 88

6.28

Extended coefficient range up to -4...4 (address 0x5A) . . . . . . . . . . . . . . 89

6.29

Miscellaneous registers (address 0x5C, 0x5D) . . . . . . . . . . . . . . . . . . . . 90

6.29.1

Rate power-down enable (RPDNEN) bit . . . . . . . . . . . . . . . . . . . . . . . . 90

6.29.2

Bridge immediately off (BRIDGOFF) bit (address 0x4B, bit D5) . . . . . . 90

6.29.3

Channel PWM enable (CPWMEN) bit . . . . . . . . . . . . . . . . . . . . . . . . . . 91

6.29.4

External amplifier hardware pin enabler (LPDP, LPD LPDE) bits . . . . . 91

6.29.5

Power-down delay selector (PNDLSL[2:0]) bits . . . . . . . . . . . . . . . . . . . 91

6.29.6

Short-circuit check enable bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

6.30

Bad PWM detection registers (address 0x5E, 0x5F, 0x60) . . . . . . . . . . . 92

6.31

Enhanced zero-detect mute and input level measurement

(address 0x61-0x65, 0x3F, 0x40, 0x6F) . . . . . . . . . . . . . . . . . . . . . . . . . . 93

6.32

STCompressorTM configuration register (address 0x6B; 0x6C) . . . . . . . . 95

6.33

Coefficient RAM CRC protection (address 0x71-0x7D) . . . . . . . . . . . . . . 96

6.34

MISC4 (address 0x7E) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

7.1

Configuration register A (addr 0x00) . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

7.1.1

Master clock select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

7.1.2

Interpolation ratio select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

7.1.3

Fault-detect recovery bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

7.2

Configuration register B (addr 0x01) . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

7.2.1

Serial data interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

7.2.2

Serial audio input interface format . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

7.2.3

Serial data first bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

7.2.4

Delay serial clock enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

7.2.5

Channel input mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

7.3

Configuration register C (addr 0x02) . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

7.3.1

FFX compensating pulse size register . . . . . . . . . . . . . . . . . . . . . . . . . 109

7.4

Configuration register D (addr 0x03) . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

7.4.1

DSP bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

7.4.2

Post-scale link . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

7.4.3

Biquad coefficient link . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

7.4.4

Zero-detect mute enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

7.4.5

Submix mode enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

7.5

Configuration register E (addr 0x04) . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

Obsolete

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- Obsolete

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