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PI3WVR31310A

DP/HDMI 1:3 De-mux/Mux switches

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10/30/15

All trademarks are property of their respective owners.

PRI_SEL

(Priority order) HPD1 HPD2 HPD3 D0P

D1P

D2P

D3P

D0N

D1N

D2N

D3N

0

0

0

0

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

0

1

x

x

D0P1

D1P1

D2P1

D3P1

D0N1

D1N1

D2N1

D3N1

0

0

1

x

D0P2

D1P2

D2P2

D3P2

D0N2

D1N2

D2N2

D3N2

0

0

0

1

D0P3

D1P3

D2P3

D3P3

D0N3

D1N3

D2N3

D3P3

M

0

0

0

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

M

1

x

0

D0P1

D1P1

D2P1

D3P1

D0N1

D1N1

D2N1

D3N1

M

0

1

0

D0P2

D1P2

D2P2

D3P2

D0N2

D1N2

D2N2

D3N2

M

x

x

1

D0P3

D1P3

D2P3

D3P3

D0N3

D1N3

D2N3

D3P3

1

0

0

0

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

Hi-Z

1

1

0

0

D0P1

D1P1

D2P1

D3P1

D0N1

D1N1

D2N1

D3N1

1

x

1

x

D0P2

D1P2

D2P2

D3P2

D0N2

D1N2

D2N2

D3N2

1

x

0

1

D0P3

D1P3

D2P3

D3P3

D0N3

D1N3

D2N3

D3P3

Note: M= VDD/2 or open (with internal VDD/2)

Note: For priority selection control, when PRI_SEL = 0, the order is port1/port2/port3; when PRI_SEL = 1, the order is port2/port3/port1; when PRI_SEL = M, the

order is port3/port1/port2.

Priority Selection Table

PRI_SEL

(Priority order) HPD1

HPD2

HPD3

HPD_SRC

CAB_SRC

AUXP/AUXN

SDA/SCL

0

0

0

0

0

Hi-Z

Hi-Z

Hi-Z

0

1

x

x

HPD1

CAB1

AUX1P/AUX1N

SDA1/SCL1

0

0

1

x

HPD2

CAB2

AUX2P/AUX2N

SDA2/SCL2

0

0

0

1

HPD3

CAB3

AUX3P/AUX3N

SDA3/SCL3

M

0

0

0

0

Hi-Z

Hi-Z

Hi-Z

M

1

x

0

HPD1

CAB1

AUX1P/AUX1N

SDA1/SCL1

M

0

1

0

HPD2

CAB2

AUX2P/AUX2N

SDA2/SCL2

M

x

x

1

HPD3

CAB3

AUX3P/AUX3N

SDA3/SCL3

1

0

0

0

0

Hi-Z

Hi-Z

Hi-Z

1

1

0

0

HPD1

CAB1

AUX1P/AUX1N

SDA1/SCL1

1

x

1

x

HPD2

CAB2

AUX2P/AUX2N

SDA2/SCL2

1

x

0

1

HPD3

CAB3

AUX3P/AUX3N

SDA3/SCL3

Note: M= VDD/2 or open (with internal VDD/2)

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