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HD6432147SW Datasheet(PDF) 266 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 266 Page - Renesas Technology Corp |
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266 / 1140 page  8. I/O ポート 233 8.3.2 レジスタ構成 表 8.6 にポート 2 のレジスタ構成を示します。 表 8.6 ポート 2 レジスタ構成 名 称 略称 R/W 初期値 アドレス* 1 ポート 2 データ ディレクションレジスタ P2DDR W H'00 H'FFB1 ポート 2 データレジスタ P2DR R/W H'00 H'FFB3 ポート 2 プルアップ MOS コントロールレジスタ P2PCR R/W H'00 H'FFAD 【注】 *1 アドレスの下位 16 ビットを示しています。 （1）ポート 2 データディレクションレジスタ（P2DDR） 7 P27DDR 0 W 6 P26DDR 0 W 5 P25DDR 0 W 4 P24DDR 0 W 3 P23DDR 0 W 0 P20DDR 0 W 2 P22DDR 0 W 1 P21DDR 0 W ビット 初期値 R/W ： ： ： P2DDR は、8 ビットのライト専用レジスタで、ポート 2 の各端子の入出力をビットごと に指定します。リードは無効です。リードすると不定値が読み出されます。 P2DDR は、リセットまたはハードウェアスタンバイモードでは、H'00 に初期化されま す。ソフトウェアスタンバイモードでは 、P2DDR は直前の状態を保持します。ソフトウ ェアスタンバイモードに遷移したとき、アドレス出力端子は出力状態を保持します。 （a）モード 1 P2DDR の設定値にかかわらず、対応するポート 1 の各端子はアドレス出力となります。 ハードウェアスタンバイモード時は、アドレス出力はハイインピーダンス状態となりま す。 |
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