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CH367 Datasheet(PDF) 9 Page - Nanjing Qinheng Microelectronics Co., Ltd. |
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CH367 Datasheet(HTML) 9 Page - Nanjing Qinheng Microelectronics Co., Ltd. |
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9 / 12 page  CH367 中文手册 ９ 名称 参数说明 最小值 典型值 最大值 单位 FCLK CLK 输入频率（PCIE 总线的主频） 0 100 105 MHz FSCL2 两线接口自动加载时 SCL 输出频率 244 260 KHz FSCL3 三线接口自动加载时 SCL 输出频率 31 35 MHz TINTEG 有效边沿中断的最小脉冲宽度 5 nS TEN IORD、IOWR 读或写选通的低电平脉冲宽度 30 可选择 30～480 480 nS TENS IORD、IOWR 连续选通的高电平间隔宽度 90 nS TAS 地址 A7～A0 输出建立时间 12 可选择 15 或 45 nS TAH 地址 A7～A0 输出保持时间 12 可选择 15 或 45 nS TDS 数据 D7～D0 输出建立时间 12 可选择 15 或 45 nS TDH 数据 D7～D0 输出保持时间 12 可选择 15 或 45 nS TIS 数据 D7～D0 输入建立时间 10 nS TIH 数据 D7～D0 输入保持时间 0 nS TSS SCK 上升沿之前 SCS 有效的建立时间 11 16 或 32 nS TSH SCK 上升沿之后 SCS 有效的保持时间 11 16 或 32 nS TNS SCK 上升沿之前 SCS 无效的建立时间 10 nS TN SCS 无效时间（SPI 操作间隔时间） 110 nS TCH SCK 时钟的高电平时间 13 16 或 32 nS TCL SCK 时钟的低电平时间 13 16 或 32 nS TDS SCK 上升沿之前 SDX/SDI 输入的建立时间 5 nS TDH SCK 上升沿之后 SDX/SDI 输入的保持时间 0 nS TOX SCK 下降沿到 SDX 输出有效或者改变 0 2 5 nS 8、应用 |
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