STA369BWSTR datasheet(4/92 Pages) STMICROELECTRONICS

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STA369BWS

4/92

DocID016861 Rev 7

7.7.3

Coefficient b2 data register bits (addr 0x1A - 0x1C) . . . . . . . . . . . . . . . 60

7.7.4

Coefficient a1 data register bits (addr 0x1D - 0x1F) . . . . . . . . . . . . . . . 60

7.7.5

Coefficient a2 data register bits (addr 0x20 - 0x22) . . . . . . . . . . . . . . . . 60

7.7.6

Coefficient b0 data register bits (addr 0x23 - 0x25) . . . . . . . . . . . . . . . . 61

7.7.7

Coefficient read/write control register (addr 0x26) . . . . . . . . . . . . . . . . . 61

7.7.8

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

7.8

Variable max power correction registers (addr 0x27 - 0x28) . . . . . . . . . . 66

7.9

Distortion compensation registers (addr 0x29 - 0x2A) . . . . . . . . . . . . . . . 66

7.10

Fault detect recovery constant registers (addr 0x2B - 0x2C) . . . . . . . . . . 66

7.11

Device status register (addr 0x2D) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

7.12

EQ coefficients and DRC configuration register (addr 0x31) . . . . . . . . . . 68

7.13

Extended configuration register (addr 0x36) . . . . . . . . . . . . . . . . . . . . . . 69

7.13.1

Dual-band DRC (B2DRC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

7.13.2

EQ DRC mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

7.14

Soft volume configuration registers (addr 0x37 - 0x38) . . . . . . . . . . . . . . 72

7.15

DRC RMS filter coefficients (addr 0x39-0x3E) . . . . . . . . . . . . . . . . . . . . . 73

7.16

Extra volume resolution configuration registers (addr 0x3F) . . . . . . . . . . 74

7.17

Short-circuit protection mode registers SHOK (addr 0x46) . . . . . . . . . . . 75

7.18

Quantization error noise correction (addr 0x48) . . . . . . . . . . . . . . . . . . . . 76

7.19

Extended coefficient range up to +4/-4 (addr 0x49, 0x4A) . . . . . . . . . . . . 77

7.20

Miscellaneous registers (addr 0x4B, 0x4C) . . . . . . . . . . . . . . . . . . . . . . . 78

7.20.1

MISC1 (addr 0x4B) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

7.20.2

MISC2 (addr 0x4C) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

7.21

Global DRC after B2DRC (GDRC) bit (addr 0x4D, bit D0) . . . . . . . . . . . . 81

7.22

Bad PWM detection registers (addr 0x4D, 0x4E, 0x4F) . . . . . . . . . . . . . . 82

7.23

Coefficient RAM CRC protection (addr 0x60-0x6C) . . . . . . . . . . . . . . . . . 82

7.23.1

BQCHKE registers (addr 0x60 - 0x62) . . . . . . . . . . . . . . . . . . . . . . . . . 82

7.23.2

XCCHKE registers (addr 0x63 - 0x65) . . . . . . . . . . . . . . . . . . . . . . . . . . 83

7.23.3

BQCHKR registers (addr 0x66 - 0x68) . . . . . . . . . . . . . . . . . . . . . . . . . 83

7.23.4

XCCHKR registers (addr 0x69 - 0x6B) . . . . . . . . . . . . . . . . . . . . . . . . . 83

7.23.5

CHKCTRL register (addr 0x6C) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83

7.23.6

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

8.1

Application schematics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

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