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HD6432147SW Datasheet(PDF) 335 Page - Renesas Technology Corp

Part # HD6432147SW
Description  HARDWARE MANUAL
PDF  1140 Pages
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Manufacturer  RENESAS [Renesas Technology Corp]
Direct Link  http://www.renesas.com
Logo RENESAS - Renesas Technology Corp

HD6432147SW Datasheet(HTML) 335 Page - Renesas Technology Corp

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10.
 14 ビット PWM タイマ（PWMX）
302
10.2.2
 D/A データレジスタ A、B（DADRA、B）
15
13
DA13
1
R/W
14
12
DA12
1
R/W
13
11
DA11
1
R/W
12
10
DA10
1
R/W
11
9
DA9
1
R/W
8
6
DA6
1
R/W
10
8
DA8
1
R/W
9
7
DA7
1
R/W
ビット（CPU）
ビット（データ）
DADRA
初期値
R/W
：
：
：
：
7
5
DA5
1
R/W
6
4
DA4
1
R/W
5
3
DA3
1
R/W
4
2
DA2
1
R/W
3
1
DA1
1
R/W
0
−
−
1
−
2
0
DA0
1
R/W
1
−
CFS
1
R/W
DADRH
DADRL
DA13
1
R/W
DA12
1
R/W
DA11
1
R/W
DA10
1
R/W
DA9
1
R/W
DA6
1
R/W
DA8
1
R/W
DA7
1
R/W
DADRB
初期値
R/W
：
：
DA5
1
R/W
DA4
1
R/W
DA3
1
R/W
DA2
1
R/W
DA1
1
R/W
REGS
1
R/W
DA0
1
R/W
CFS
1
R/W
DADR
は、16 ビットのリード／ライト可能な 2 本のレジスタ（DADRA、B）で構成さ
れています。DADRA は PWM（D/A）チャネル A に、DADRB は PWM（D/A）チャネル B
にそれぞれ対応します。DADR の値は、CPU からリード／ライト可能ですが、16 ビット
構成になっているため、CPU とのデータ転送はテンポラリレジスタ（TEMP）を介して行
います。詳細は
「10.3 バスマスタとのインタフェース」を参照してください。
DADRA
の最下位ビット（CPU）は未使用で、リードすると 1 が読み出されます。
DADR
は、リセット、スタンバイモード、ウォッチモード、サブアクティブモード、サ
ブスリープモードまたはモジュールストップモード時に、H'FFFF に初期化されます。
ビット 15∼3：D/A データ 13∼0（DA13∼0）
DADR
の上位 14 ビットは、D/A 変換データを設定します。
DADR
の上位 14 ビットの内容は、DACNT の値と常に比較されており、基本周期ごとに
出力波形のデューティを決定し、また分解能幅の付加パルスを出力するか否かを決定しま
す。この動作を可能にするためには、DADR をある範囲の値に設定する必要があります。
この範 囲はキャ リアフリ ーケンシ セレクト （CFS）に よって決 まります 。範囲外 の値を
DADR
に設定すると、PWM 出力は固定されます。
12
ビット精度で使用する場合には、下位 2 ビット（データ）（DA1、0）を 0 に固定し、
上位 12 ビット（データ）が有効と見なします。この下位 2 ビット（データ）は DACNT
の上位 2 ビット（カウンタ）に対応しています。



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