ADC1015S datasheet(39/39 Pages) NXP

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NXP Semiconductors

ADC1015S series

ADC1015S series; input buffer; CMOS or LVDS DDR digital output

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Date of release: 12 April 2010

Document identifier: ADC1015S_SER_1

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16. Contents

General description . . . . . . . . . . . . . . . . . . . . . . 1

Features and benefits . . . . . . . . . . . . . . . . . . . . 1

Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2

Ordering information . . . . . . . . . . . . . . . . . . . . . 2

Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 3

Pinning information . . . . . . . . . . . . . . . . . . . . . . 4

6.1

Pinning . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4

6.2

Pin description . . . . . . . . . . . . . . . . . . . . . . . . . 4

Limiting values. . . . . . . . . . . . . . . . . . . . . . . . . . 6

Thermal characteristics . . . . . . . . . . . . . . . . . . 6

Static characteristics . . . . . . . . . . . . . . . . . . . . . 7

Dynamic characteristics . . . . . . . . . . . . . . . . . 10

10.1

Dynamic characteristics . . . . . . . . . . . . . . . . . 10

10.2

Clock and digital output timing . . . . . . . . . . . . 12

10.3

SPI timings . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Application information. . . . . . . . . . . . . . . . . . 15

11.1

Device control . . . . . . . . . . . . . . . . . . . . . . . . . 15

11.1.1

SPI and Pin control modes . . . . . . . . . . . . . . . 15

11.1.2

Operating mode selection. . . . . . . . . . . . . . . . 16

11.1.3

Selecting the output data standard . . . . . . . . . 16

11.1.4

Selecting the output data format. . . . . . . . . . . 16

11.2

Analog inputs . . . . . . . . . . . . . . . . . . . . . . . . . 16

11.2.1

Input stage . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

11.2.2

Transformer . . . . . . . . . . . . . . . . . . . . . . . . . . 17

11.3

System reference and power management . . 19

11.3.1

Internal/external references . . . . . . . . . . . . . . 19

11.3.2

Reference gain control . . . . . . . . . . . . . . . . . . 20

11.3.3

Common-mode output voltage (VO(cm)) . . . . . 20

11.3.4

Biasing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

11.4

Clock input . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

11.4.1

Drive modes . . . . . . . . . . . . . . . . . . . . . . . . . 21

11.4.2

Equivalent input circuit . . . . . . . . . . . . . . . . . . 22

11.4.3

Duty cycle stabilizer . . . . . . . . . . . . . . . . . . . . 22

11.4.4

Clock input divider . . . . . . . . . . . . . . . . . . . . . 22

11.5

Digital outputs . . . . . . . . . . . . . . . . . . . . . . . . . 23

11.5.1

Digital output buffers: CMOS mode . . . . . . . . 23

11.5.2

Digital output buffers: LVDS DDR mode . . . . . 24

11.5.3

Data valid (DAV) output clock . . . . . . . . . . . . . 25

11.5.4

Out-of-Range (OTR) . . . . . . . . . . . . . . . . . . . . 25

11.5.5

Digital offset . . . . . . . . . . . . . . . . . . . . . . . . . . 25

11.5.6

Test patterns . . . . . . . . . . . . . . . . . . . . . . . . . . 25

11.5.7

Output codes versus input voltage . . . . . . . . . 26

11.6

Serial peripheral interface. . . . . . . . . . . . . . . . 26

11.6.1

11.6.2

Default modes at start-up . . . . . . . . . . . . . . . . 27

11.6.3

Package outline. . . . . . . . . . . . . . . . . . . . . . . . 35

Revision history . . . . . . . . . . . . . . . . . . . . . . . 36

Legal information . . . . . . . . . . . . . . . . . . . . . . 37

14.1

Data sheet status . . . . . . . . . . . . . . . . . . . . . . 37

14.2

Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

14.3

Disclaimers . . . . . . . . . . . . . . . . . . . . . . . . . . 37

14.4

Trademarks . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Contact information . . . . . . . . . . . . . . . . . . . . 38

Contents. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

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