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HD6432147SW Datasheet(PDF) 435 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 435 Page - Renesas Technology Corp |
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435 / 1140 page  13. タイマコネクション 402 ビット 7：VSYNCI エッジ（VEDG） VSYNCI 端子の立ち上がりエッジを検出します。 ビット 7 説 明 VEDG 0 【クリア条件】 （初期値） VEDG=1 の状態で VEDG をリードした後、VEDG に 0 をライトしたとき 1 【セット条件】 VSYNCI 端子の立ち上がりエッジを検出したとき ビット 6：HSYNCI エッジ（HEDG） HSYNCI 端子の立ち上がりエッジを検出します。 ビット 6 説 明 HEDG 0 【クリア条件】 （初期値） HEDG=1 の状態で HEDG をリードした後、HEDG に 0 をライトしたとき 1 【セット条件】 HSYNCI 端子の立ち上がりエッジを検出したとき ビット 5：CSYNCI エッジ（CEDG） CSYNCI 端子の立ち上がりエッジを検出します。 ビット 5 説 明 CEDG 0 【クリア条件】 （初期値） CEDG=1 の状態で CEDG をリードした後、CEDG に 0 をライトしたとき 1 【セット条件】 CSYNCI 端子の立ち上がりエッジを検出したとき |
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