CS1256 datasheet(18/35 Pages) CHIPSEA

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图 3.2 PGA 和 ADC 结构图

输入信号的增益 Gain 由 PGA 和 ADC 各自增益的乘积决定。

ADGN

PGA

Gain





(式 3-1)

为了提高信号的建立表现，PGA 输出到 ADC 调制器输入还有 Buffer 作为缓冲；但同

时提供 Buffer 旁路功能，将 BUFBP 置’1’，则 Buffer 被旁路，PGA 输出信号直接接入 ADC

的调制器。 CS1256 的差分满幅输入范围 FS 由 Gain 决定，

Gain

REFN

REFP

)

(





(式 3-2)

若差分输入通道 AINp-AINn=VIN，则为保证不溢出，VIN 的范围必须小于 FS。

CS1256 的 ADC 采用 2 阶 sigma-delta 调制器实现，内部采样频率为 331.11KHz(普通模

式)或 662.22KHz(性能模式)；增益 ADGN 可由电容倍增和频率倍增实现。

CS1256 的 ADC 带有内部增益温漂补偿功能，通过 GTCSL 以及 GTC[2:0]可以配置。当

GTCSL=1 时为粗调档，此时对应 GTC[2:0]增益温漂补偿的一个步长为 30ppm/℃，可用于

补偿外部传感器的温漂；而当 GTCSL=0 时，相应步长为 5ppm/℃，可用于调整芯片内部的

增益温漂。

3.3

数字滤波器

从 Sigma-delta ADC 出来的数据是 1 位的高速比特流数据，并且包含了大量的高频噪

声，因此需要数字滤波器对该比特流数据进行滤波和比特率转换，将高频噪声滤除、同时

完成降采样，将 1 位高速比特流数据变成 24-bit 的二进制码数据。这个工作通过多阶的

COMB 滤波器完成。COMB 滤波器之后可以选择是否使用滤波器进一步进行滤波。

3.3.1

频率响应

图 3.3 COMB 滤波器的频率响应特性(Fs=331Hz，DR=10Hz，3 阶 COMB）

CS1256 Datasheet(PDF) 18 Page - Core Technology (Shenzhen) Co., Ltd.

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