List of Illustrations

iv

November 2002

SLES041B

3.9

Individual Channel Mute Register (x19)

27

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4

System Initialization

28

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5

Specifications

29

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5.1

Absolute Maximum Ratings Over Operating Temperature Ranges

29

. . . . . . . . . . . . . . . . . . . . . . .

5.2

Recommended Operating Conditions

29

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

5.3

Electrical Characteristics

29

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5.3.1

Static Digital Specifications

29

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5.3.2

Digital Interpolation Filter and PWM Modulator

29

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

5.3.3

TAS5026/TAS5100 System Performance Measured at the Speaker Terminals

30

. . .

5.4

Switching Characteristics

30

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

5.4.1

Command Sequence Timing

30

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

5.4.2

Serial Audio Port

34

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

5.4.3

Serial Control Port—I2C Operation

37

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6

Application Information

38

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6.1

Serial Audio Interface Clock Master and Slave Interface Configuration

39

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6.1.1

Slave Configuration

39

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

6.1.2

Master Configuration

39

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7

Mechanical Data

40

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List of Illustrations

Figure

Title

Page

2–1 Crystal Circuit

8

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2–2 External PLL Loop Filter

10

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2–3 I2S 64-Fs Format

11

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2–4 I2S 48-Fs Format

12

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2–5 Left-Justified 64-Fs Format

12

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2–6 Left-Justified 48-Fs Format

13

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2–7 Right-Justified 64-Fs Format

13

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2–8 Right-Justified 48-Fs Format

14

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2–9 DSP Format

14

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2–10 Attenuation Curve

17

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2–11 De-Emphasis Filter Characteristics

19

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2–12 PWM Outputs and H-Bridge Driven in BTL Configuration

21

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–13 Typical I2C Sequence

21

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2–14 Single Byte Write Transfer

22

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2–15 Multiple Byte Write Transfer

22

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2–16 Single Byte Read

22

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2–17 Multiple Byte Read

23

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4–1 RESET During System Initialization

28

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5–1 RESET Timing

30

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5–2 Power-Down and Power-Up Timing—RESET Preceding PDN

31

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5–3 Power-Down and Power-Up Timing—RESET Following PDN

32

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5–4 Error Recovery Timing

33

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5–5 Mute Timing

33

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