TAS5028 datasheet(6/84 Pages) TI

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List of Tables

May 2004

SLES112

3 - 5 Power-Down Timing

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3 - 6 Error Recovery Timing

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3 - 7 Mute Timing

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3 - 8 HP_SEL Timing

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3-9 I2S Format 64 Fs Format

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3 - 10 Left Justified 64 Fs Format

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3 - 11 Right Justified 64 Fs Format

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4 - 1 Typical I2C Sequence

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4 - 2 Single Byte Write Transfer

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4 - 3 Multiple Byte Write Transfer

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4 - 4 Single Byte Read Transfer

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4 - 5 Multiple Byte Read Transfer

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List of Tables

Table

Title

Page

1 - 1 Serial Data Formats

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1 - 2 TAS5028 Audio Processing Feature Sets

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1 - 3 Bass and Treble Filter Selections

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1 - 4 Linear Gain Step Size

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2 - 1 Device Outputs During Reset

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2 - 2 Values Set During Reset

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2 - 3 Device Outputs During Power Down

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2 - 4 Device Outputs During Backend Error

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2 - 5 Description of the Channel Configuration Registers (0x05 to 0x0C)

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2 - 6 Recommended TAS5028 Configurations for Texas Instruments Power Stages

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2 - 7 Audio System Configuration (General Control Register 0xE0)

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2 - 8 Volume Ramp Rates in ms

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2 - 9 Inter-Channel Delay Default Values

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6 - 1 Clock Control Register

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6 - 2 General Status Register (0x01)

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6 - 3 Error Status Register (0X02)

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6 - 4 System Control Register 1

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6 - 5 System Control Register 2

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6 - 6 Channel Configuration Control Registers

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6 - 7 Headphone Configuration Control Register

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6 - 8 Serial Data Interface Control Register Format

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6 - 9 Soft Mute Register

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6 - 10 Automute Control Register

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6 - 11 Automute PWM Threshold and Backend Reset Period

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6 - 12 Modulation Index Limit Register

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6 - 13 Interchannel Channel Delay Registers

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6 - 14 Channel Offset Register

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6 - 15 Bank Switching Command

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6 - 16 Input Mixer Registers Format (0x41 – 0x48, Channels 1 - 8)

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6 - 17 Bass and Treble Bypass Register Format (0x89 - 0x90)

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6 - 18 Output Mixer Control Register Format (Upper 4 Bytes)

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