TMS320F datasheet(15/389 Pages) TI

15 / 389 page

Figures

xvi

6–5.

Generation of Data Addresses in Direct Addressing Mode

6-5

. . . . . . . . . . . . . . . . . . . . . . . . . .

6–6.

Instruction Register Content in Indirect Addressing

6-12

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–1.

Bit Numbers and Their Corresponding Bit Codes for BIT Instruction

7-44

. . . . . . . . . . . . . . . .

7–2.

Bit Numbers and Their Corresponding Bit Codes for BITT Instruction

7-46

. . . . . . . . . . . . . . .

7–3.

LST #0 Operation

7-86

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–4.

LST #1 Operation

7-87

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–1.

TMS320 ROM Code Procedural Flow Chart

B-2

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–1.

14-Pin Header Signals and Header Dimensions

C-2

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–2.

Emulator Cable Pod Interface

C-5

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–3.

Emulator Cable Pod Timings

C-6

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–4.

Emulator Connections Without Signal Buffering

C-10

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–5.

Emulator Connections With Signal Buffering

C-11

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–6.

Target-System-Generated Test Clock

C-12

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–7.

Multiprocessor Connections

C-13

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–8.

Pod/Connector Dimensions

C-14

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–9.

14-Pin Connector Dimensions

C-15

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–10. Connecting a Secondary JTAG Scan Path to a Scan Path Linker

C-17

. . . . . . . . . . . . . . . . . . .

C–11.

EMU0/1 Configuration to Meet Timing Requirements of Less Than 25 ns

C-21

. . . . . . . . . . . .

C–12. Suggested Timings for the EMU0 and EMU1 Signals

C-22

. . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–13. EMU0/1 Configuration With Additional AND Gate to Meet Timing

Requirements of Greater Than 25 ns

C-23

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–14. EMU0/1 Configuration Without Global Stop

C-24

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–15. TBC Emulation Connections for n JTAG Scan Paths

C-25

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